8.1 七号信令测试仪下位机实现及源码分析
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更新于2008-10-13 15:57:26

下位机的实现就是实现MPC8260对DS21354的控制,从而进行信令的收发。DS21354是E1单片收发器。片上时钟/数据恢复电路可以将AMI/HDB3的E1模拟信号转化为NRZ数据流,而且可以自动校准到22AWG的E1线路。片上时钟/数据恢复电路还可以生成符合G.703标准的波形(适用与75欧和120欧的对绞电缆)。片上的jitter attenuator可以适用与收发数据线路。成帧器可以定位帧和复帧二进制比特流,同时可以监控远端报警。成帧器还可以用来提取和插入信令数据。Si-bit和Sa-bit信息。片上HDLC控制器用来控制sa-bit链路和DS0。DS21354包含一系列的片上内部寄存器,用户可以利用这些寄存器来控制DS21354。多个并行控制端口可以使单个控制传递很多E1线路。DS21354最大可能兼容ITU-TG.703, G.704, G.706, G.823, G.732, and I.431, ETS300 011, 300 233, and 300 166, as well as CTR12和CTR4.

特性:
E1(CEPT)PCM-30/ISDN-PRI收发器
Long- Haul 和 Short-Haul接口的片上时钟/数据恢复电路
32-bit和128-bit的jitter attenuator
支持FAS、CAS、 CCS和CRC4格式的帧
带64byte的buffer的HDLC控制器,用来配置sa-bit、DS0。
交织PCM总线
8-bit端口可以直接用作Multiplexed或Nonmultiplexed总线
提取和插入CAS信令
侦测和产生远端告警和AIS告警
可编程的输出时钟
独立的发送、接收功能
下面我们来具体应用DS21354到我们的仪器当中。
8.1.1 DS21354 收发信令过程、寄存器描述及数据结构实现
8.1.1.1 DS21354功能描述

模拟的AMI/HDB3信号从E1线上传到DS21354的RRING和RTIP上管脚,再通过时钟/数据恢复恢复电路和JITTER ATTENUATION MUX传递到接收端的成帧器(串行数据流被分析以锁定成帧方式 是否是复帧)。DS21354包含了活动的滤波器,他能为在传输过程中的非线性失真重建接收到的模拟信号。DS21354/554接收端的灵敏度达0-43DB。所以设备可以工作在2000m的距离上。接收端的成帧器可以定位FAS帧以及CRC CAS等复帧边界和侦听接收的告警,载波丢失,同步丢失,AIS和远程告警。如果需要,接收方可以在RSYSCLK管脚上调整E1数据流与异步时钟的差异,RSYSCLK时钟频率可以按需要调整为2.048MHz/4.096MHz/8.192MHz或1.544MHz。

发送成帧器与接收成帧器在时钟频率和性质上完全独立。数据在必要的情况下可以在发送端弹性存储设备传输。发送成帧器可以为E1信号提供帧/复帧的开销字段。
备注:本书所述的E1帧我们做以下规定:在每个帧为125us ,有32个8bit时隙,编号为0-31。时隙0先发先送,0到31时隙分别对应1-32个信道。时隙0为信道1,时隙1为信道2,依次类推。每个时隙由8个bit组成,规定编号为1-8。bit1为MSB(most significant bit)最先传输,bit8为LSB(least significant bit)最后传输。锁定的意思就是两个时钟信号的周期和频率被锁定或者由公共时钟倒出。
 8.1.1.2 DS21354引脚控制
DS21354/DS21354通过nonmultiplexed总线(MUX=0)或multiplexed总线由外部处理器控制。DS21354/DS21354由Intel或Motorola处理器控制。如果BTS管脚被拉低,则Intel时序被选定;如果BTS管脚被拉高,则Motorola时序被选定
8.1.1.3 DS21354寄存器概述

对DS21354的操作是通过10个control registers进行的。一般情况下,系统初次上电,control registers才被访问。系统初始化后,只有当系统设置变更时control registers才被再次修改。10个control registers由2个receive control registers(RCR1和RCR2),2个transmitcontrol registers(TCR1和TCR2)和6个common control registers (CCR1到CCR6)。本小结介绍这10个寄存器。


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