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»FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
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FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
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发表于2008-03-26 18:30
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
FPGA设计时序收敛只在高速设计中使用吗？
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Rob
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发表于2008-03-26 19:41
42#
RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
hehe 我也要求进步!
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liuwei_uestc
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发表于2008-03-28 00:33
43#
RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
谢谢分享！！！！！！！！！！！
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duxiaoqing
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发表于2008-03-29 21:15
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回复:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
看看
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beetle
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发表于2008-03-30 15:02
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
Thank you!
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jephen
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发表于2008-03-30 17:25
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
口口口口口口口看看看俺
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发表于2008-03-31 07:41
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
谢谢分享，看看了！！！！！
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发表于2008-04-01 23:06
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回复：FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
原帖由bomidog于2007-11-20 19:37发表:
ding!!!
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jeffery163
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发表于2008-04-03 10:27
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
谢谢分享，支持楼主！！！
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发表于2008-04-03 19:06
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RE:FPGA设计时序收敛 [天津工业大学Xilinx信号传输与处理联合实验室]
timing constraints... just need it. thx
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