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  • CLKIN使用GCLK脚,基本无使用问题。 但由于板上的布线及管脚限制,第一板使用了LHCLK脚,使用ISE10.1相关附属工具 Architecture Wizard产生 DCM模块,在对管脚约束后,CLKIN使用LHCLK脚(XS3C100E-TQ144,P88 脚),用ISE综合后PALCE&ROUTE产生如 下错误(ISE版本:10.1 nt): ERROR:Place:1012 - A clock IOB / DCM component pair have been found that are not placed at an optimal clock IOB / DCM    site pair.  The clock component is placed at site .  The clock IO/DCM site can be paired i...

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  • 原核经过修改控制SDRAM大小后,存在以下问题:     如在将写入SDRAM的时候,中间产生自动刷新操作,刷新操作正确执行,同时数据写入操作并未停止而继续进行,但由于控制核在进行刷新操作,数据未能经过 控制核正确输出并写入SDRAM中。     在原Xilinx SDRAM控制器中ref_cntr.v文件中,对变量“rcount”进行监控,当“rcount”小于10时,通过控制核输出DO_REF信号为 ‘1’。     SDRAM控制器输入接口(负责初始化控制器、将读写命令发送给控制核并控制进...

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