FPGA_FPGA是什么意思 - 与非网

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电路方案

FPGA 处理器
 雷卯针对创龙科技TL3562-EVM-B工业评估板防雷防静电方案

leiditech

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FPGA xilinx
频率测量系统的设计VHDL代码Xilinx ISE仿真

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上升沿触发的N进制计数器的设计Verilog代码Quartus仿真

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2025/12/09

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FPGA Quartus
基于FPGA的FIR数字滤波器的设计Verilog代码Quartus仿真

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2025/11/27

2283
FPGA Quartus
选择器译码器组合逻辑电路设计VHDL代码Quartus仿真

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2025/10/15

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FPGA verilog
SOBEL边缘检测例程设计Verilog代码Quartus AX301开发板

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2025/10/15

1568
FPGA Quartus
病房呼叫系统设计VHDL代码Quartus仿真

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2025/10/15

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FPGA Quartus
QPSK调制解调设计VHDL代码Quartus仿真

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2025/10/15

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FPGA verilog
乒乓球比赛游戏设计Verilog代码Quartus仿真

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2025/10/14

1246
FPGA verilog
OV5640摄像头显示设计Verilog代码Quartus AX301开发板

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2025/10/14

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FPGA verilog
直接测频频率计设计Verilog代码Quartus仿真

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2025/10/14

1319
FPGA Quartus
对一个方波的任意周期延迟设计VHDL代码Quartus仿真

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2025/10/14

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FPGA verilog
DPSK和QPSK调制设计Verilog代码Quartus仿真

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2025/10/14

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FPGA verilog
计时电路设计Verilog代码Quartus仿真

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2025/10/14

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FPGA verilog
SD卡读取BMP图片并显示设计Verilog代码Quartus AX301开发板

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2025/10/13

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设计资料

LAT1323 STM32L452 I2C关闭时钟延展功能的使用

意法半导体(ST) 397.69 KB
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2025/03/24
FPGA
FPGA-to-ASIC 转换参考手册

安森美半导体
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FPGA ASIC

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【黑金云课堂】FPGA技术教程FPGA基础：按键实验
按键抖动现象分析机械按键的物理结构机械按键由弹性触点、弹簧机构和导电材料组成。当按下或释放按键时，弹簧的弹性势能使触点产生振动，导致触点不能立即稳定接触或断开。电平跳变的表现形式抖动表现为短时间内电平的多次跳变。FPGA的高速时钟（通常50MHz）会将这些跳变识别为多次独立的按键操作，导致系统行为异常。抖动带来的问题计数器误触发：单次按键导致计数器多次增加状态机异常：状态跳转不符合预

ALINX 官方

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FPGA FPGA开发板
FPGA零基础入门开发上手流程硬件工程师进阶学习指南
在电子硬件高速研发领域，FPGA凭借并行运算处理速度快、硬件可编程、实时性强、适配高速信号处理等核心优势，在工业控制、视频图像处理、通信信号传输、高速数据采集、军工电子等领域应用广泛。相较于MCU嵌入式开发，FPGA开发上手门槛偏高，需要掌握Verilog编程语法、硬件逻辑设计、时序约束配置、仿真调试等专业知识，很多硬件工程师、电子专业应届生想要进阶学习FPGA开发，却不知道从何入手，学习规划杂乱

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05/05 11:05

FPGA
基于RLS自适应滤波与互相关对齐的数据分析链路
本文深入解析了递归最小二乘（RLS）自适应滤波的数学原理及其在MATLAB中的实现，重点介绍了定点量化、互相关对齐技术和FPGA硬件实现的关键步骤。通过定点量化和COE文件生成，实现了算法的高效硬件移植。RLS的核心在于快速收敛和高精度滤波，特别适合处理非平稳噪声。互相关对齐技术有效消除了群延迟的影响，提升了实际应用中的信号保真度。整体上，本文为工程师提供了从算法设计到硬件实现的全面指南，助力于构建高性能的自适应降噪系统。

小灰灰的FPGA

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FPGA 数据分析
基于FPGA定点实现双路信号的互相关计算和延迟对齐
该系统实现了一个互相关计算模块，支持数据延迟调整。通过独立控制两个RAM的读取地址，实现不同延迟量的功能。在FPGA与Matlab仿真中验证了互相关峰值正确性和信号相位一致性。源码包含完整的硬件描述语言和软件实现。

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04/28 15:23

FPGA 计算模块
基于FPGA及神经网络SSD算法目标检测系统设计
本文介绍了基于FPGA的SSD目标检测算法的移植与优化。首先，详细阐述了SSD算法的基本原理及其在不同层次的特征提取和目标检测中的作用。接着，描述了SSD算法在PYNQ平台上的实现步骤，包括卷积、池化、L2范数等模块的设计与优化。文中还讨论了并行设计和量化设计的具体措施，以提高算法的执行效率和资源利用率。此外，文章提到了Python网络搭建的过程，通过调用卷积和池化单元实现主干特征网络，并对特定检测层进行分类预测和回归预测。最后，总结了项目的完成情况和性能参数，指出当前实现的功能满足预定要求，但在工作时钟频率和数据并行性方面仍有待改进。

FPGA技术江湖

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04/28 10:27

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