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  • 洗衣机控制系统 FPGA设计 Verilog Quartus
    本项目实现了一个基于FPGA的洗衣机控制系统，使用Verilog在Quartus中完成设计。系统模拟洗衣机的完整工作流程，包括启动、洗涤、暂停、清洗、暂停、脱水、暂停和结束等阶段，并通过LED与数码管直观显示当前状态和剩余时间。设计支持4种工作模式：正常模式、单独洗涤、单独清洗和单独甩干。系统使用50MHz主时钟，内部实现精确到秒的倒计时控制。电机动作通过LED进行模拟显示。该设计适合用于FPGA课程设计、数字逻辑综合实验、状态机设计学习以及开发板综合验证。
    589
    06/09 07:45
    洗衣机 FPGA设计
  • 数字时钟FPGA设计Verilog Vivado
    一款基于FPGA的数字时钟系统，使用Verilog语言在Vivado环境下设计并实现。该系统能够显示小时、分钟、秒钟，并支持手动设置时间。系统包括分频、计时、按键消抖、数码管显示和PWM输出等功能模块。设计适用于FPGA数字系统课程设计和实验，具有清晰的模块结构和易于扩展的特点。
    461
    06/08 10:45
    verilog vivado
  • 汽车转向灯与交通灯控制 FPGA设计 Verilog Quartus
    本文档介绍了基于Verilog和Quartus的汽车转向灯与交通灯控制FPGA设计项目。该项目包含两个实验工程：汽车转向灯控制和交通灯控制。转向灯部分通过按键控制左转、右转和紧急双闪，并输出LED模拟效果。交通灯控制部分实现了红绿灯状态切换和倒计时显示。设计采用了有限状态机实现转向灯控制，并使用分频计数器产生闪烁节拍。交通灯控制模块则采用模块化设计，包含红绿灯控制和数码管显示模块。项目提供了完整的Verilog源码、Quartus工程配置、仿真波形和设计文档图片，适用于数字逻辑课程设计和FPGA入门学习。
    892
    06/08 08:45
    交通灯控制 FPGA设计
  • 流水灯FPGA设计Verilog Vivado
    一款基于Verilog和Vivado的流水灯FPGA设计，实现了8位LED流水灯控制。设计采用模块化结构，包括分频模块和LED控制器，支持自定义流水速度。附带详细文档和仿真结果，适用于FPGA入门和教学。
    260
    06/08 08:45
    verilog vivado
  • 交通灯控制 FPGA设计Verilog Quartus DE2-115
    交通灯控制FPGA设计Verilog Quartus DE2-115，使用Verilog语言实现主路与支路红、黄、绿灯时序控制，通过数码管显示倒计时时间。系统输入50MHz时钟，内部分频得到1Hz计时基准，适用于数字逻辑课程设计和Verilog时序控制学习。
    285
    06/08 07:45
    交通灯控制 FPGA设计
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