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• 首次启动之前：莱迪思FPGA如何赋能人形机器人平台

  人形机器人已进入到大型物流仓库中搬运货物、在汽车装配线上排列零部件，并在全球一些最大的订单履行中心开展试点运营。可以说人形机器人的第一波浪潮已经到来，其并非停留在实验室或演示中，而是在真实的生产环境中承担实际工作。高盛预测到2035年，该市场规模将达到380亿美元。而今天正在设计的人形机器人平台，正是未来随这一增长实现规模化扩张的关键。 但制造人形机器人与制造传统机器截然不同。人形机器人是一个分布

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  FPGA 人形机器人
• 【黑金云课堂】FPGA技术教程Vitis开发：PS端RS485通信

  一、RS485 简介 1.1 核心定义与发展背景 标准定义 RS-485（TIA/EIA-485-A）仅规定物理层电气标准，无上层通信协议，可搭载 Modbus RTU、DL/T645 等工业协议，是工业现场总线通用物理层标准。 迭代由来（对比 RS232 缺陷） RS232：单端传输、点对点通信，最大传输距离 15m，抗干扰差，无法多节点组网； RS485 基于 RS422 升级，采用差分传输，

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  FPGA FPGA开发板
• 【黑金云课堂】FPGA技术教程FPGA基础：SD卡读写实验

  一、实验概述 本实验基于纯 FPGA 板卡，通过 SPI 接口驱动 SD 卡，实现底层硬件与存储介质的直接交互。SD 卡作为嵌入式系统的核心存储介质，内部集成了 NAND Flash 控制器，可简化主机对存储介质的管理。本实验是音频播放、图片读取、系统日志等高级功能的基础。 核心目标 理解FPGA与SD卡的SPI硬件连接 掌握SD 2.0协议SPI模式规范 运用Verilog HDL构建SD卡SP

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  06/29 11:37

  FPGA
• 【黑金云课堂】FPGA技术教程Linux开发：DP音频播放与VCU视频解码

  一、DP 音频播放 1. 音频基础知识 数字音频由采样率、位深、声道数三个参数定义。 参数 说明 常见值 采样率 每秒采样次数 44100Hz(CD)、48000Hz(DVD) 位深 单个采样存储位数 16bit、24bit、32bit 声道数 音频通道数量 1 (单声道)、2 (立体声) 计算公式：比特率 = 采样率 × 位深 × 声道数 示例：CD 音质 = 44100 × 16 × 2 =

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  06/25 09:13

  FPGA Linux
• 【黑金云课堂】FPGA技术教程FPGA基础：串行接口RS422 & RS485通信

  一、核心通信原理 1. 定义与特点 RS422 / RS485 是美国电子工业协会（EIA）制定的串行通信接口标准，仅定义物理层电气特性，需配合 UART、Modbus RTU 等高层协议使用。 两者均采用差分信号传输，与 RS232 单端信号显著不同，具备极强的抗干扰能力和长距离传输能力（最远 1200 米）。 2. 差分信号优势 使用一对互补信号线（A/B 或 Y/Z），接收端比较两线电压差还

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  06/23 17:05

  FPGA FPGA开发板
• 2026 慕尼黑上海电子展，ALINX FPGA 展品抢先看！

  2026年7月1日至7月3日，慕尼黑上海电子展（electronica China）将在上海新国际博览中心盛大举行。 ALINX 将携最新高端 FPGA 平台、异构计算系统、射频通信方案、FMC 子卡、汽车电子后视镜系统及硬件在环仿真测试等多款方案产品亮相展会。 现场更有展位打卡礼、互动体验礼等多重福利等您领取。欢迎前来体验前沿技术，也把惊喜礼品带回家。 我们把搭载电子后视镜系统的特斯拉Model

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  06/20 09:36

  FPGA 开发板
• 【黑金云课堂】FPGA技术教程Vitis开发：QSPI FLASH 与 AXI_GPIO

  一、QSPI Flash 简介 QSPI（Quad SPI）Flash 是在传统 SPI Flash 基础上发展而来的高速串行存储器，通过 IO0～IO3 四根数据线并行传输数据，相比普通 SPI 具有更高的数据吞吐率，同时保持简单的接口和较低的成本。 其主要特点包括： 4 线并行数据传输，速度更快 向下兼容 SPI，支持 XIP 接口简单，引脚少 容量多样，速度高 成本较低，适用于嵌入式系统 二

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  06/18 09:57

  FPGA Vitis
• 【黑金云课堂】FPGA技术教程FPGA基础：I2C 总线通信技术

  FPGA 基础第 11 期 I2C 总线通信技术，选自ALINX 黑金云课堂 FPGA 免费直播课。该课程由 ALINX 资深工程师团队倾力打造，从 0 到 1 系统化教学，帮助每位工程师跨过 FPGA 开发门槛。 🔍 ALINX：关注 ALINX，进入视频号即可查看完整黑金云课堂 FPGA 视频教程。配合笔记学习效果更佳。 一、I2C基本原理 总线特点半双工、同步、多主多从的串行通信总线，仅需两

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  06/14 09:37

  FPGA I2C
• ALINX VD100+Simulink 快速实现 FPGA 图像处理 Sobel 边缘检测

  基于 ALINX VD100 的 Simulink 图像处理实践 原文作者：Adam Taylor 原文标题：MicroZed Chronicles: Creating Image Processing with Simulink 原文链接：https://www.adiuvoengineering.com/post/microzed-chronicles-creating-image-proce

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  FPGA 图像处理
• 【黑金云课堂】FPGA技术教程Linux开发：摄像头GPU渲染显示/Qt OpenGLES使用

  一、MPSoc GPU 基础知识 MPSoC 系列芯片采用 Mali-400 MP2 图形处理器，隶属 ARM Mali 系列第一代 Utgard 架构，支持 OpenGL ES1.1/2.0、OpenVG1.1，最大 4096×4096 纹理，400MHz 下像素填充率 800Mpixels/s。 简述 GPU 发展史：PC 端主流为 Intel、NVIDIA、AMD，移动端 ARM Mali

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  FPGA GPU
• 免费送！米尔邀您共聚2026AEC FPGA技术峰会

  2026年6月11日，米尔电子将亮相杭州2026 AEC FPGA技术峰会。 作为领先的嵌入式处理器模组厂商，米尔将携安路FPGA核心板和开发板亮相。我们诚邀您共聚西子湖畔，一同探索FPGA技术在边缘计算、工业控制与AI加速等领域的最新技术突破与落地实践。 作为本次峰会的亮点之一，米尔现场还将免费赠送15套安路飞龙派开发板，助力开发者快速上手国产FPGA设计与原型验证。数量有限，先到先得，欢迎届时

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  06/09 12:53

  FPGA 米尔科技

  
• 序列检测器FPGA设计VHDL Vivado

  本文档详细介绍了一个基于FPGA的序列检测器的设计，使用VHDL语言在Vivado环境下实现。设计包含13路输入信号和14路输出信号，支持手动复位和100MHz板载时钟输入。顶层模块`sequence_detector`负责检测逻辑，输出检测结果和观察时钟。工程还包括仿真测试模块`tb_sequence_detector`和管脚约束文件`pins.xdc`，支持FPGA板级验证。设计适用于教学实验、课程设计和入门项目调试。

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  FPGA vhdl
• 病房呼叫显示控制 FPGA 设计 Verilog ISE

  本文档详细介绍了一款基于Verilog的FPGA病房呼叫显示控制系统的设计，适用于病房按键呼叫、待处理状态指示和病房号数码管显示。系统包含5路按键输入、LED指示和七段数码管显示，通过控制模块和显示模块实现呼叫管理和状态显示。设计文档提供了完整的工程文件、程序文件、编译结果和仿真图，支持学习和仿真实验。

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  FPGA verilog
• 秒表跑表FPGA 设计 VHDL Quartus

  一款基于FPGA的秒表/跑表设计，采用VHDL编写并使用Quartus开发。设计适用于DE2-115开发板，实现计时、控制和数码管显示功能。系统通过50MHz时钟分频至100Hz，实现10ms计时单位。按键输入经消抖处理，保证控制稳定性。显示部分使用数码管输出计时结果，包含分频、按键消抖、跑表控制和显示驱动等模块。此设计作为FPGA课程设计、数字逻辑实验和VHDL模块化设计训练的参考工程。

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  06/08 08:45

  FPGA vhdl
• 出租车计费系统FPGA设计Verilog Quartus

  这是一个基于FPGA的出租车计费系统的设计，使用Verilog语言在Quartus环境下完成。系统通过启动信号开始计费，通过停止信号结束计费过程，并使用运行指示灯表示车辆处于行驶/计费状态。计费过程中，系统内部产生公里使能信号，用于推动里程累计和费用计算；当前里程与计费金额通过数码管进行显示。顶层接口包含时钟、复位、启动、停止、LED指示和数码管控制信号，便于在FPGA开发板上完成完整的输入控制与显示验证。

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  06/08 08:45

  FPGA verilog

  
• 【黑金云课堂】FPGA技术教程Linux开发：NVMe/Qt/OpenCV人脸检测

  一、NVMe读写 设备模型：NVMe 是面向 PCIe SSD 的高性能存储协议，Linux 中常见节点包括 /dev/nvme0、/dev/nvme0n1、/dev/nvme0n1p1。 PetaLinux配置：需要启用 PCIe 支持、Xilinx PCIe Host 控制器和 NVM Express block device，并在 rootfs 中加入 nvme-cli、e2fsprogs、

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  FPGA Linux
• FPGA逐步切入AI服务器

  2026年全球AI服务器架构转向CPU+GPU/NPU+FPGA三级异构，FPGA全面介入智算服务器互联调度、网络卸载、大模型推理加速、KV缓存预处理四大核心环节。英伟达GTC 2026发布Groq3 LPX推理机架，每托盘标配1颗FPGA做集群调度枢纽，单机架合计32颗FPGA，正式把FPGA写入AI推理机架官方硬件规格。互联方面，FPGA在单芯片内部署多套协议栈并支持动态在线重配，灵活性高。计算方面，FPGA在效能比、时延确定性与功能集成度三个维度具备优势，通过可重叠迭代逻辑与112Gbps PAM4 SerDes集成于同一芯片，在板间互联中应用。新一代FPGA集成高速SerDes、PCIe6.0硬核，原生支撑800G/1.6T以太网，在AI服务器内承担SmartNIC/DPU，梯度压缩、集群数据分片、协议转换、网卡卸载，把GPU/NPU从网络开销中释放，集群带宽利用率从70%提升至95%以上，解决千卡集群互联瓶颈。

  智能计算芯世界

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  AI FPGA
• 【黑金云课堂】FPGA技术教程Vitis开发：PS端SD读写

  PS 端 SD 卡读写SD 卡原理 1. SD 卡分类 分类方式 类型 尺寸 标准 SD 卡、Micro SD（TF 卡） 速度等级 Class 2/4/6/10，UHS-1 U1/U3 容量 SD (≤2GB)、SDHC (≤32GB)、SDXC (≤2TB) 2. Micro SD 卡引脚说明 3. SD 卡命令与应答格式 Command 命令格式 启动位 主机 命令码 命令参数 CRC 停止

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  06/04 15:58

  FPGA FPGA开发板
• FPGA中的IDDR的DDR_CLK_EDGE的属性选择区别

  本文介绍了FPGA中IDDR的DDR_CLK_EDGE属性的选择区别，详细解释了OPPOSITE EDGE、SAME EDGE和SAME EDGE PIPELINED三种模式的特点，并给出实际应用实例，强调了正确选择模式的重要性。

  郝旭帅电子设计团队

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  06/04 15:03

  FPGA

  
• 【黑金云课堂】FPGA技术教程FPGA基础：FIFO与Uart通信

  一、FIFO 基础概念 定义：FIFO（First In First Out）是一种先进先出的数据缓冲结构，先写入的数据先被读出。 1. 核心特性 读写顺序一致 支持同时读写 提供空（empty）和满（full）状态指示 2. 与 RAM/ 寄存器的区别 FIFO 自动管理指针，无需地址控制，适合顺序访问和速率匹配。 3. 核心价值 跨时钟域（CDC）：消除亚稳态风险 数据缓冲：解耦生产与消费 速

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  06/02 15:52

  FPGA UART

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