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描述
该参考设计和相关的示例 Verilog 代码可用作将 Altera FPGA 连接到德州仪器 (TI) 高速 LVDS 接口模数转换器 (ADC) 和数模转换器 (DAC) 的起点。其中说明了固件实施并介绍了所需的计时限制。
特性
该设计仅为固件，并进行了详细论述以帮助理解
示例 Verilog 代码是 FPGA 连接到高速数据转换器应用的简单起点
该设计可轻松扩展到其他 TI 高速数据转换器
ADC 和 DAC 部分是分开的，以防只需使用其中一个
详细介绍了有关 DAC 和 ADC 的接口计时限制
已使用现成的 TI EVM 对固件进行了测试
| 器件型号 | 数量 | 器件厂商 | 器件描述 | 数据手册 | ECAD模型 | 风险等级 | 参考价格 | 更多信息 |
|---|---|---|---|---|---|---|---|---|
| XC6SLX9-L1CPG196I | 1 | AMD Xilinx | Field Programmable Gate Array, 715 CLBs, 9152-Cell, CMOS, PBGA196, 8 X 8 MM, 0.50 MM PITCH, LEAD FREE, BGA-196 |
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$204.26 | 查看 |
| EP4CE55F23C8 | 1 | Intel Corporation | Field Programmable Gate Array, 3491 CLBs, 472.5MHz, 55856-Cell, PBGA484, 23 X 23 MM, 1 MM PITCH, FBGA-484 |
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$1086.23 | 查看 |
| XC6SLX16-2CSG225I | 1 | AMD Xilinx | Field Programmable Gate Array, 1139 CLBs, 667MHz, 14579-Cell, CMOS, PBGA225, 13 X 13 MM, 0.80 MM PITCH, LEAD FREE, BGA-225 |
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$27.05 | 查看 |
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