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本章节介绍CMOS技术的基础知识以及执行静态时序分析所涉及的术语。
经常看到有文章介绍对SDRAM布线的各种要求,这只是工程上的经验总结,不同的芯片对时序的要求不同,对走线也有不同的要求,不能一概而论。其实,等长不是目的,真正的目的是满足芯片的建立保持时间,采样正确。由于FR4中的走线的传播延时近似值为6英寸/ns,根据时序关系可以转化为PCB Layout(印制板布局)的走线线长关系。
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