Multi-Die_Multi-Die是什么意思

通用芯粒互连技术（UCIe）为半导体行业带来了诸多可能性，在Multi-Die设计中实现了高带宽、低功耗和低延迟的Die-to-Die连接。它支持定制HBM（cHBM）等创新应用，满足了I/O裸片与HBM DRAM堆叠裸片之间对高带宽连接的需求。本文将深入探讨UCIe支持的不同接口，以实现片上网络（NoC）互连。 UCIe标准层 UCIe定义了一套全面的协议层，用于标准化裸片（也称为芯粒）之间的通

新思科技

7089

08/03 09:30

新思科技Synopsys UCIe

带宽提升25%！新思科技40G UCle IP，助力高性能Multi-Die设计

为了确保Multi-Die设计成功，通用芯粒互连技术（UCIe）规范应运而生。它通过提升互操作性、降低延迟、实现异构裸片间相互通信等方式，简化了Multi-Die设计中的Die-to-Die连接。

新思科技

1298

02/18 11:20

UCIe Multi-Die

2025年，Multi-Die技术将被50%新型 HPC芯片所采用

过去几十年来，单片芯片一直是推动技术进步的主力。但就像工业革命期间，役畜被更高效强大的机器所取代一样，半导体行业如今也处于类似变革的阶段。Multi-Die和基于小芯片的设计，即将多个专用芯片集成在单个封装中或将集成电路垂直堆叠，有望带来比单片芯片更高的性能和灵活性，能够满足高性能计算（HPC）以及AI驱动的工作负载对处理能力永无止境的需求。但是，要开发这些先进的芯片设计，需要极其雄厚的资金和前沿的研发能力。

新思科技

1308

02/17 16:45

HPC芯片 Multi-Die

早期架构探索：Multi die系统设计的关键

人工智能应用和大语言模型（LLM）的兴起，自动驾驶汽车、智能交通系统以及车内互联体验的不断创新，以及电子设备的智能化和互联化不断加强，对芯片性能和实时计算和控制功能都提出了更高的要求，传统SoC已经难以满足这些不断演进的应用需求。

TechSugar

1834

2024/03/12

芯片架构 Multi-Die

万物智能不打烊！2024 年关于Multi-Die系统的四大猜想

ChatGPT等应用作为生活中不可或缺的工具，需要海量数据才能维持正常运转。截至2023年6月，ChatGPT的训练数据集达3,000亿个字词，日访问量达6,000万次，每天有超过1,000万次的查询，而这只是一个开始。人工智能（AI）和高性能计算（HPC）等技术正在蓬勃发展，这些应用需要的带宽和算力只会越来越大。所以如果要打造一个真正的智能世界，需要的系统规模和复杂程度真的很难想象。

新思科技

926

2024/01/11

芯片架构 Multi-Die

Multi-Die

文章