《数字集成电路静态时序分析基础》笔记④

2020/11/29 作者：贝塔

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STA 基本概念

STA 工具，全芯片，门级静态时序分析

在不同阶段都可以使用 STA，但是吃的文件不同，流程越往后精度越高

有两个模式，pt_shell 和 GUI

分为连线延迟和单元延迟

传输延迟，逻辑延迟

起点可能是 D 触发器的 clk 或者 input port，终点可能是 D 触发器的 input pin(D)或者 output port

现在的 SoC 都是全局异步，局部同步，具备多个时钟域。

三个操作环境：P/V/T

三种模型：slow、typical、fast

高温、低电压会使延迟最大，在这个条件下检查建立时间

低温、高电压会使延迟最小，在这个条件下检查保持时间

更多器件

器件型号	数量	器件厂商	器件描述	ECAD模型	参考价格	更多信息
EP2C35F484C8N	1	Intel Corporation	Field Programmable Gate Array, 2076 CLBs, 402.5MHz, 33216-Cell, CMOS, PBGA484, LEAD FREE, FBGA-484		$104.3	查看
XC6SLX9-2TQG144C	1	AMD Xilinx	Field Programmable Gate Array, 715 CLBs, 667MHz, 9152-Cell, CMOS, PQFP144, 20 X 20 MM, 0.50 MM PITCH, LEAD FREE, TQFP-144	ECAD模型下载ECAD模型	$17.08	查看
5M570ZF256I5N	1	Altera Corporation	Flash PLD, 17.7ns, 440-Cell, CMOS, PBGA256, 17 X 17 MM, 1 MM PITCH, LEAD FREE, FBGA-256	ECAD模型下载ECAD模型	暂无数据	查看