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  • 从系统角度深入分析VCO选型规则
    文章主要介绍了时钟时序、相位噪声与误码率BER的相关知识，特别是针对VCO选择时如何评估其对系统性能的影响。文中详细解释了相位抖动的概念、单点噪声与积分相位噪声的关系，以及如何通过单点噪声计算积分相位噪声并将其转换为均方根相位抖动。同时，文章还讨论了256QAM调制方式下，不同相位抖动量级对误码率的影响，并通过星座图进行了直观演示。最后，文章指出即使在较强的加性高斯白噪声环境下，外侧符号的统计弥散范围仍然大于内侧符号，强调了相位抖动对系统性能的重要影响。
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    相位噪声 时序
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    数模接口时序路径，是模拟IP内的ADC2数字域的第一级寄存器（ff1 reg）。时钟是ADC时钟，时钟source点是模拟IP内的grp pin(对应模拟IP内PLL的输出端)。时钟频率是2GHz（时钟周期是500ps）。
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    06/25 08:07
    蓝牙 时序
  • 艾德克斯OBC/车载充电机测试系统-负载效应测试、输出电压范围测试
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    时序 车载充电机
  • [SPI] 主机发送时序优化：缩短 CS 到 SCLK 的延迟
    在使用HPM_SDK的SPI主机示例时，常见的问题是CS先被拉低，但一段时间内无SCLK，随后SCLK才连续输出。这是由于SPI启动后TX FIFO暂无数据，DMA尚未开始搬运所致。本文提出优化流程，即先配置和启动DMA，再配置和启动SPI，从而缩短CS→SCLK的首字节延迟并增强整帧连续性。此优化将在HPM SDK 1.11.0版本中提供。
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    05/25 10:08
    SPI 时序
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