高速信号

• 学习笔记之传输线损耗

  摘要：文章讨论了高速信号传输线中的导体损耗和介质损耗问题，并介绍了如何通过选择不同表面粗糙度的铜箔和低损耗材料来降低这些损耗。文中详细解释了趋肤效应及其对导体损耗的影响，以及介质损耗的原因和特性。通过实例展示了不同材料在高频下的损耗差异，强调了在高速信号设计中考虑材料特性的必要性。

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  12/09 08:55

  高速信号 传输线

  
• 我的板子为什么测不了损耗

  珠海高速实验室开放，推出高速信号测试视频。详细介绍了如何使用矢量网络分析仪测量阻抗和损耗，并解释了为何手持探头不适合测量损耗的原因。对于实物板损耗测试，建议在设计阶段尽量选择带有SMA头的产品以便于测量。

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  11/22 08:25

  高速信号 信号损耗

  
• 高速板材为什么贵？单看这一点你们就明白了！

  高速先生分享了关于高速板材与普通FR4板材在损耗方面的对比研究。通过仿真数据表明，M8级别的高速板材相较于普通FR4板材具有显著的低损耗优势，特别是在高频段（如14GHz和28GHz）表现尤为突出。尽管高速板材价格较高且存在备料周期，但由于其出色的损耗特性，使得在高速信号应用中成为必要选择。此外，虽然损耗只是其中一个考量因素，但在实际应用中，高速板材的选择还需综合考虑其他因素，例如材料稳定性、生产工艺、成本效益等。

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  11/21 09:17

  高速信号 信号损耗

  
• 被人忽视的“ILD”指标，竟隐藏着高速设计的核心思维

  文章介绍了高速信号设计中的重要指标——ILD（插损偏离度），解释了其定义及其对信号质量和眼图性能的影响，并通过实例展示了ILD指标的实际作用。文章还提出了一个问题：在高速信号PCB设计中，哪些设计问题可能导致插损的ILD指标变差。

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  11/21 08:24

  pcb设计 高速信号

  
• 距离一样时，你们知道两对过孔怎么摆串扰最小吗？

  文章讨论了如何有效降低高速信号过孔间的串扰问题，并提出了一种新颖的解决方案——通过旋转过孔位置来改善串扰效果。实验结果显示，适当的角度旋转可以显著提高串扰性能，尤其是在90度旋转时，串扰几乎降至最低值。这表明旋转策略能有效克服传统拉开距离法的局限，为高速信号设计提供了新的思路。

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  11/21 08:24

  过孔 高速信号
• 别蒙我，这几对高速走线怎么看我都觉得一样！

  Chris讨论了高速PCB设计中过孔优化的重要性，并指出即使是简单的表层差分走线，拐弯补偿间隔的不同也能显著影响信号性能。通过仿真对比，展示了不同拐弯间隔下信号损耗的变化，强调了设计细节对高性能信号传输的关键作用。

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  11/21 07:24

  pcb设计 过孔

  
• 同一个过孔会有不同的阻抗？？？

  两位高速先生队员对一块带有SMA同轴连接器的测试板进行过孔阻抗测试时，因使用不同终止频率导致测量结果出现显著差异。最终发现，当测试频率从10GHz增加至40GHz时，过孔阻抗逐渐降低。

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  11/20 08:24

  阻抗 过孔

  
• 隔离地过孔要放哪里，才能最有效减少高速信号过孔串扰？

  本文探讨了如何通过合理规划隔离地过孔的位置来减少两对高速信号过孔之间的串扰。通过仿真结果显示，当隔离地过孔靠近时串扰效果最佳，而非传统的水平放置方式。此外，文中还介绍了珠海PCB制板厂在高速信号过孔优化方面的技术支持。

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  10/28 16:58

  过孔 高速信号

  
• 高速信号双通道SOT-23低电容ESD防护

  上海雷卯常常接到新老客户咨询：“有高速信号用的两通道双向3.3V或5V....电压ESD二极管吗 ？我们有两个I/O口需要做静电防护，比如SOT-23 封装。” 为满足客户需求上海雷卯研发推出以下双通道系列ESD ，封装SOT-23，广泛应用于高速数据I/O口，I2C, eSATA, USB2.0, USB3.0，HDMI1.3, HDMI1.4，LAN和WAN(百兆，千兆） 接口应用。 l LC

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  07/09 15:14

  电容 ESD
• Samtec虎家大咖说 硬核分享 什么是线缆的Skew

  【前言】 本次的文章来源于Samtec首席技术专家兼总监布兰登・戈尔（Brandon Gore）博士对线缆Skew的一次深入分享探讨。 我们截取了部分讨论的重点内容。一如既往，分享给大家，希望抛砖引玉，带来一些不一样的思考。 让我们以一问一答，进入今天的硬核技术分享~ ——电缆线对内Skew有哪些类型？ 我们一般依据屏蔽层内的内导体数量来对电缆进行分类。在高速数字测试场景中，会用到同轴电缆（只有一

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  07/08 08:56

  连接器 线缆
• 凡亿Allegro Skill布线功能-自动创建match_group

  在进行高速PCB设计的过程中，常常会遇到一个挑战，那就是高速信号的时序匹配问题。为了确保信号的同步到达，设计者需要对特定的高速信号组进行等长设计。手动进行这样的操作可能会非常繁琐且容易出错。

  凡亿教育

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  06/17 11:10

  pcb设计 Allegro

  
• 如何用电源去耦电容改善高速信号质量

  大家都知道，信号的最佳回流路径是GND：对于走线而言，我们希望能参考GND平面；对于信号管脚，我们希望GND管脚伴随；对于BGA区域的高速信号扇出过孔，我们希望能被相邻的GND过孔包围。

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  05/20 16:24

  高速信号 去耦电容

  
• 硬件企业的好搭档 | Samtec互连解决方案

  【摘要/前言】 对于硬件企业来说，将概念转化为最终产品涉及到独特的挑战。最近的行业报告显示，供应链问题、预算紧张以及对快速原型设计的需求使这一过程变得困难重重。 电子硬件领域的一些处于发展中的企业尤其受到这些障碍的影响，它们在努力寻找专业组件和可靠的合作伙伴以支持其发展。 【驾驭复杂的供应链】 硬件企业面临的一个主要问题是全球供应链中断。这些干扰导致半导体、电缆和连接器等重要部件的交付周期延长，给

  Samtec中国

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  05/13 13:40

  pcb 连接器

  
• 高速传输线阻抗一直往上跑？怎么解决

  长通道的阻抗一直往上窜这个事情其实不是个别现象了，相信大多数做高速串行信号的朋友，尤其是做背板系统的朋友都深有体会，在超过例如10inch走线的时候，如果你们去测试加工出来的差分线的TDR阻抗，就很容易看到以下的曲线。

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  04/09 11:17

  阻抗 高速信号

  
• LVDS分离器简化高速信号分配

  随着微处理器、DSP和数字ASIC时钟频率的提高，背板信号的通信速率也在不断提高。较快的时钟速率使得基于TTL的单端信号的弱点越来越突出，主要表现在：功耗增大、抖动(导致误码)、高电平辐射、传输线效应(如阻抗失配和串扰)、电源去耦难度增大以及其它一些问题。尽管一般认为利用该技术速率能够保持在50MHz以上，但是，上述问题迫使设计人员寻求更为有效的解决方案。

  亚德诺半导体

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  03/11 10:26

  LVDS 高速信号

  
• 高速数字信号的匹配问题

  在高速数字信号中，PCB布线的目的，就是保证接收端能够正确接收到发射端的信号。正确体现在两个方面：(1)如果设计到时钟的话，需要保证时序的正确性；

  加油射频工程师

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  01/29 09:25

  数字信号 高速信号

  
• 【原创干货】高速信号是否需要包地处理

  当我们在做高速PCB设计时，很多工程师都会纠结于包地问题，那么高速信号是否需要包地处理呢？

  凡亿教育

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  01/28 09:55

  高速信号

  
• Samtec 人工智能深度分享 | 如何管理海量数据

  【摘要/前言】 人工智能，或者说，计算机的智能，它就在我们身边，但我认为重要的一点是：这种智能是由人类智能驱动的。正是人工智能背后的人类创新激发了计算机的创造、适应和使用，使我们的生活变得更加轻松。通过让计算机专注于人工智能任务，我们可以把更多的时间放在人际交往、家庭、旅游以及各种人生冒险经历上。 人工智能还能帮助提高准确性和精确度。拥有一个庞大的数据源，可以在几毫秒内快速提取和分析数据，这有助于

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  2024/12/02

  人工智能 是德科技
• 明明我说的是25G信号，你却让我看12.5G的损耗？

  关于高速信号损耗要看哪个频点的问题，高速先生真的一年都要被咨询几十次！还是以我们比较熟悉的25G光模块信号为例子来开始我们今天这篇文章吧。下图是一个简单的25G光模块的PCB设计，从芯片到光模块连接器这一段链路，也就是我们高速先生常常称为host的光模块链路。

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  2024/10/22

  光模块 高速信号

  
• 【PSIJ测试应用方案】探索PSIJ之谜—由电源引起的高速信号抖动

  PSIJ，那是一场无声的风暴 在高速信号传输的世界里，每一个细微的“波动”都可能引发巨大的影响。而如今，一个隐匿的“杀手”正悄然威胁着高速信号的稳定性——那就是电源引起的高速信号抖动PSIJ（Power Supply Induced Jitter）。这个看似陌生的术语，却在电子领域掀起了一场无声的风暴。当高速信号供电电源受到挑战，高速信号便如同在波涛汹涌的大海中航行的船只，摇摆不定，失去了精准的方

  与非网编辑

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  2024/09/23

  DDR 高速信号

  

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