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ARM体系结构之:I/O管理

2013/09/13
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2.4  I/O管理

ARM系统完成I/O功能的标准方法是使用存储器映射I/O。这种方法使用特定的存储器地址。当从这些地址加载或向这些地址存储时,它们提供I/O功能。某些ARM系统也可能有直接存储器访问(DMA,Direct Memory Access)硬件

外围设备(如串行线控制器)中包含一些寄存器。在存储器映射系统中,这些寄存器就像特定地址的存储器一样。(在其他的系统组织中,I/O功能可能与存储器件有不同的寻址空间。)串行线控制器可能有以下5种寄存器。

① 发送数据寄存器(只写):写入这个位置的数据被送往串行线。

② 接受数据寄存器(只读):保存从串行线送来的数据。

③ 控制寄存器(读/写):设置数据速率,管理RTS(请求发送)和其他类似信号。

④ 中断使能寄存器(读/写):控制中断的硬件事件。

⑤ 状态寄存器(读/写):指示读数据是否有效、写缓存是否满等。

要接受数据,必须用软件适当地设置器件。通常在接收到有效数据或检测到错误时产生一个中断。中断程序必须将数据复制到缓存器中并进行错误检测。

应该注意的是,存储器映射外围寄存器的行为与存储器不同。连续两次读数据寄存器,即使对该寄存器没有写操作,其结果也很可能不同。而对真正存储器的读是幂等的(idempotent)(可多次重复读,结果一致)。对外围寄存器的读操作可能清除当前值,致使下一次读结果不同。这种寄存器称为读敏感(read-sensitive)的。

当涉及读敏感寄存器时,编程必须小心。特别是不能将这种寄存器的数据复制到Cache存储器。

在许多ARM系统中,不能在用户模式下访问I/O寄存器。要访问这些器件,只能通过监控调用(SWI)或通过使用这种调用的C库函数。

注意

在ARM编程中,通常将存储器的I/O区域标记为非Cache区(uncacheable),并绕过Cache访问。通常Cache与读敏感(read-sensitive)器件相互排斥。显示帧缓存器(DisplayFrame Buffers)也需要仔细考虑,通常也设为不可Cache的。

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ARM公司是一家知识产权(IP)供应商,主要为国际上其他的电子公司提供高性能RISC处理器、外设和系统芯片技术授权。目前,ARM公司的处理器内核已经成为便携通讯、手持计算设备、多媒体数字消费品等方案的RISC标准。公司1990年11月由Acorn、Apple和VLSI合并而成。

ARM公司是一家知识产权(IP)供应商,主要为国际上其他的电子公司提供高性能RISC处理器、外设和系统芯片技术授权。目前,ARM公司的处理器内核已经成为便携通讯、手持计算设备、多媒体数字消费品等方案的RISC标准。公司1990年11月由Acorn、Apple和VLSI合并而成。收起

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