芯耀
与非AI
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1.输入文件概述
RedHawk‑SC 作为芯片电源完整性、电压降及电迁移签核核心工具，仿真精度高度依赖各类工艺、设计、激励与配置输入文件。根据用途可将所有输入分为工艺库数据、设计数据、控制配置数据、3DIC专属数据、热分析专属数据五大类，覆盖常规IR/EM签核、多 die 堆叠、器件自加热等全场景分析。
第一类为工艺与库数据，是仿真的底层模型基础。Tech文件是Ansys专用工艺文件，由Foundry的ITF或iRCX工艺文件转换生成，内部包含各层金属、通孔的RC寄生参数与EM电迁移约束规则，为电源网格RC提取、压降计算和可靠性检查提供工艺基准。LEF文件描述单元物理结构，包含层定义、通孔规则、单元轮廓与引脚信息，用于工具搭建完整设计物理视图，多LEF叠加冲突时以最后加载版本为准。Liberty库提供标准单元基础功耗与时序属性，包含漏电动耗、内部功耗、端口电容等参数，未匹配lib的单元无法计入功耗统计。APL是RedHawk高精度专属电流库，可输出单元真实PG瞬时电流波形与引脚固有电容模型，相比lib默认三角波电流模型精度更高，缺失APL会导致动态IR结果偏悲观。GDS版图主要用于SRAM、IO等宏单元建模，通过gds2rh工具提取内部电源网格，补全原厂LEF缺失的内部PG结构。
第二类为设计数据，承载芯片物理布局与翻转激励信息。DEF记录全芯片单元摆放、网表连接、PG网格布线与电源开关位置，是电源网格提取的核心物理依据。SPEF存储信号线寄生RC参数，主要用于计算信号翻转功耗，不参与电源网络RC提取。STA时序文件由PrimeTime生成，包含时钟域、时序窗口、转换速率等信息，用于无向量动态仿真，通过翻转率统计生成等效电流。VCD、FSDB、SAIF为翻转活动文件，记录单元动态跳变行为，是高精度动态电压降仿真的核心激励。Pad/Tap文件定义C4 bump、电源PAD的坐标与金属层位置，确定芯片供电原点，直接决定IR压降与有效电阻计算基准。封装模型用于芯片‑封装协同仿真，完善全局PDN阻抗分析。
第三类为控制与配置数据，用于定义仿真流程与参数。GSR是工程主配置文件，统一导入所有工艺、设计文件，配置仿真工况、电压温度与分析模式，是启动RedHawk工程的入口。Command与GSC脚本用于精细化控制仿真流程，支持电源网格编辑、去耦电容配置、电源域开关状态控制等操作。Macro模型为Memory、IP等宏单元的简化抽象模型，解决大尺寸宏单元仿真耗时、精度不足的问题，保障整体仿真效率与准确性。
第四类为多Die/3DIC专属输入数据，适配堆叠芯片仿真。通过上下层Die的DEF与PLOC文件搭建堆叠架构，配合TSV、混合键合的层间寄生参数，结合虚拟顶层网表，实现3D堆叠电源完整性、层间压降与EM的联合仿真。
第五类为自加热热分析专属数据，用于器件热效应仿真。包含功耗与信号EM视图、代工厂自加热工艺文件、标准单元热阻文件与实例功耗文件，用于分析器件发热对电阻、压降、电迁移的影响，完成热‑电耦合签核。
常规静态、动态IR drop与EM签核的核心输入为tech、LEF、lib、APL、DEF、SPEF、STA、翻转激励文件、PAD文件及GSR配置文件，其中tech决定工艺底层精度，APL决定动态电流精度，是影响PI仿真结果最关键的两类文件。
2.ITF
ITF是Synopsys生态标准互连工艺文本文件，与Cadence生态ICT文件功能对等，是芯片RC寄生提取、EM电迁移分析的核心工艺数据源。文件包含全局工艺参数、介质层、金属导体层、通孔四大核心模块，定义了层厚、介电常数、金属方块电阻、最小线宽间距、通孔电阻及工艺缩放系数等关键电学、物理参数。
ITF是EDA工艺建模源头文件，可转换生成TLUPlus、nxtgrd供StarRC使用，也可直接导入RedHawk-SC构建工艺视图，支撑电源完整性仿真。在3D IC项目中，ITF需定义TSV、HB等堆叠层，适配工艺缩放差异，解决键合层、通孔的工艺映射与寄生提取问题，是数字后端时序、寄生、PI全流程仿真的基础工艺文件。
3.APL
APL（Apache Power Library）是 Ansys Redhawk‑SC 专属的高精度电源电流模型库，是芯片动态电压降 DVD 与瞬态 EM 签核的必备工艺输入。APL 由 Foundry 利用 apldi 工具基于 HSPICE 晶体管级仿真表征生成，用于精准描述标准单元动态电流特性；SRAM、IP 等宏单元无标准 APL，统一采用 AVM 模型作为等效 Macro 电流库。相较于传统 Liberty NLPM 功耗模型仅能输出理想化三角波平均电流，APL 精度优势显著。它可根据不同输入翻转状态、转换速率与负载条件，输出真实、非对称的瞬时电流脉冲波形。同时 APL 内置标准单元电源引脚的本征去耦电容 CDEV与串联等效电阻 ESR，能够真实模拟单元内部 MOS 结电容的电荷补偿能力，有效还原芯片瞬时电源噪声抑制效果，是动态电源完整性仿真精度的核心保障。
APL 文件由三部分构成：current 文件存储不同工况下的 VDD/VSS 瞬时电流波形；cdev 文件定义单元本征去耦电容与 ESR 串联模型，是抑制瞬时压降的关键；pwcdev 为先进 FinFET 工艺的电压相关分段电容模型，属于可选配置。
整体物理模型可等效为：每个单元电源引脚挂载瞬时动态电流源 + ESR串联CDEV本征去耦网络。在工程应用中，APL 与 Liberty 分工明确。静态 IR‑Drop、漏电功耗分析仅依赖 Liberty 库，不需要 APL；但所有动态瞬态仿真，包括动态电压降 DVD、Transient‑EM 瞬态电迁移检查，必须依赖 APL。若缺失 APL，工具会自动降级使用 Liberty 三角波模型，完全忽略单元自带本征去耦电容，无法模拟局部电荷补偿效应，导致峰值压降被放大、动态 IR 结果偏悲观，无法通过流片 Sign‑off。
实际仿真流程中，APL 仅负责单元动态电流激励与本征电容建模，不参与电源网格 RC 提取，PG 网络电阻电容仍由 tech 工艺文件结合 DEF 版图几何结构提取。工程使用必须严格保证 APL、tech、Liberty 的工艺 Corner 一一对应，禁止跨 Corner 混用。同时宏单元必须加载专属 AVM 模型，不可复用标准单元 APL，否则会造成 SRAM 动态电流、压降分析完全失真。此外，APL 仅作用于 PG 电源网络，信号线功耗与 EM 分析不调用 APL 模型。
4.PLOC
PLOC（Pad Location File）是RedHawk‑SC电源完整性分析必选核心输入文件，用于精准定义芯片电源、地电压源接入位置，是IR‑Drop、有效电阻EffR、EM分析的计算起点，也是单Die、多Die 3DIC、Package协同仿真的通用供电点位配置文件。简单来说，PLOC记录“电源从版图哪个坐标、哪层金属、哪个电源网络流入芯片”，是工具放置理想电压源Tap点位的唯一依据。
PLOC为标准文本格式，分为5列基础格式与6列扩展格式。基础格式包含供电点名、X/Y坐标、金属层、电源网络名，适用于常规单Die仿真；扩展格式增加SPICE端口名，用于封装RLC映射和多Die堆叠场景。文件中所有坐标必须与DEF版图坐标体系完全匹配，金属层必须对应版图真实PG金属图形，电源网络名需与DEF网表严格一致，否则会出现电压源悬空、供电失效，导致IR压降和电阻计算完全失真。
在工程仿真场景中，全芯片仿真采用真实C4 Bump坐标，供电点置于顶层最高金属层，贴合实际封装配电工况；Block子模块无真实Bump，必须使用边界虚拟PLOC，将供电点放置在模块边界PG Port上，模拟顶层供电输入。禁止在Block内部自定义供电点位，否则会跳过端口至内部的电源阻抗，低估真实IR压降，得到过于乐观的错误结果。此外，Pad映射文件可通过截取PLOC关键列快速生成，数模混合仿真也依靠PLOC定义模拟电源供电点位。PLOC不参与电源网格RC提取，仅负责定义电压源物理接入位置，但其点位精度、层级匹配、网络匹配直接决定整套IR、EffR、EM结果的真实性，是PI签核中影响仿真基准的核心配置文件。
5.TWF
TWF（Timing Window File）是ANSYS RedHawk‑SC专属时序窗口文件，是无向量动态DVD压降、瞬态EM仿真的核心必备输入，专门用于全芯片动态电源完整性签核。TWF由PrimeTime通过pt2timing.tcl脚本导出，基于STA时序结果记录各时钟域、各单元的有效翻转时间区间，是区别“真实仿真波形”与“时序统计模型”的关键工程文件。
与VCD、FSDB真实波形不同，TWF属于轻量级时序统计模型。VCD/FSDB精度最高、文件体量巨大，仅适用于小模块精准仿真；而TWF文件体积小、覆盖全芯片，是大规模设计Vector‑less无向量动态仿真的主流方案，解决了全芯片VCD波形过大、无法仿真的工程痛点。
TWF文件内部包含时钟域定义、单元起止翻转时间窗口、翻转率、转换速率与时序余量等关键信息。其核心作用是精准约束单元工作时段，过滤无效随机翻转。若无TWF，RedHawk会默认所有单元在全程随机翻转，产生虚假超大峰值电流，导致动态DVD压降结果极度悲观、无法收敛。同时TWF可区分多时钟域的相位差异，还原芯片错峰翻转的真实工况，避免仿真结果虚高失真。
在工程流程中，TWF负责定义单元何时翻转，APL负责定义单元翻转的真实瞬时电流波形，二者必须搭配使用，才能拟合出贴合实际的全芯片动态电流波形，完成动态电压降与瞬态EM可靠性分析。TWF仅参与动态仿真，静态IR压降、平均功耗计算无需TWF。
针对多电压域低功耗设计，TWF需要与GSC电源配置文件协同工作，由GSC管控电源域上下电状态，TWF匹配单元翻转时序，精准计算上电冲击电流与动态压降。 TWF是全芯片动态PI签核的核心时序激励文件，通过STA时序统计模型替代超大容量仿真波形，在保证仿真合理性的同时大幅提升运算效率，是工业界全芯片动态IR、瞬态EM分析的标准输入。
6.RMS / Average / Peak 三种电流
在 Redhawk‑SC 电源完整性签核中，电流分为 Average 平均电流、RMS 均方根电流、Peak 峰值电流 三类，三者物理意义不同、仿真用途严格区分，分别对应静态 IR、DC‑EM、瞬态 EM、动态 DVD 四大核心检查项，是 PI 面试最高频基础考点。
Average 平均电流是仿真周期内电流的时间算术平均值，只保留直流稳态分量，抹平所有瞬时电流尖峰。工程上主要用于静态 IR‑Drop 压降分析与 DC‑EM 直流电迁移检查，评估芯片长期稳态工作下的直流压降与金属迁移可靠性。其缺点是无法体现瞬时同时翻转的冲击电流，因此静态 IR 往往无法捕捉瞬时最坏压降情况。
RMS 均方根电流是热等效电流，通过平方平均开根号计算，对脉冲波动与电流尖峰高度敏感，数值恒大于等于平均电流。RMS 反映导体真实焦耳热累积效应，是 Foundry 脉冲 EM 规则的核心判据，专门用于 Transient‑EM 瞬态电迁移签核。很多设计平均电流合规、DC‑EM 无违例，但电流跳变剧烈、RMS 发热超标，会出现瞬态 EM 报错，是先进工艺可靠性检查的重点。
Peak 峰值电流是仿真窗口内的瞬时最大电流尖峰，持续时间极短，不影响金属长期迁移寿命，但会瞬间在电源网格 RC 上产生巨大电压塌陷。因此 Peak 电流专门用于 Dynamic DVD 动态电压降分析，同时用于评估电源门控模块上电的 Inrush 冲击电流。Peak 电流不参与任何 EM 可靠性计算。
三者工程大小关系固定为：Peak > RMS > Average，分工明确、不可混用。静态分析看平均电流、发热可靠性看 RMS 电流、瞬时噪声压降看峰值电流。
静态 IR 关注长期稳态压降，所以用 Average；动态 DVD 关注瞬时冲击塌陷，必须用 Peak；DC‑EM 看长期直流迁移，依赖 Average；Transient‑EM 看脉冲发热损伤，依赖 RMS。严禁用 Peak 跑静态 IR，否则结果极度悲观、不符合真实工况。
7.effr
effr（Effective Resistance）是Redhawk‑SC电源完整性分析的核心等效直流电阻指标，以PLOC文件定义的C4-bump或虚拟供电点为起点，计算到芯片模块或单元负载端的PDN整体等效电阻，是评估芯片供电网络优劣、支撑PI签核的关键参数。
effr计算公式为压降除以平均电流（effr=ΔV_avg/I_avg）。芯片电源网格是金属、通孔构成的复杂多路径并联网络，不存在单一固定物理路径，因此effr是基于真实电流分布加权得到的统计等效电阻，区别于单纯由版图几何决定的DCR直流电阻。电流分布改变，effr数值会随之变化，而DCR仅与线宽、长度、工艺参数相关，不受电流影响。
effr在工程中具备多重核心用途，可直观评估整体PDN供电能力，快速定位高阻抗、易压降的薄弱区域，指导加宽电源金属、加密strap、增加通孔与供电bump数量。同时可用于对比不同模块供电质量，完成Block与全芯片工况的关联性预判，也是生成CPM简化电源模型、支撑2.5D/3DIC系统级仿真的关键输入参数。
影响effr的核心因素包含供电点位置与密度、高层金属资源、通孔数量、模块距供电端距离以及内部电流集中程度。工程仿真中存在诸多关键要点：effr完全依赖PLOC配置，Block仿真若将供电点置于内部，会导致effr虚低、评估失真。此外，effr仅表征直流稳态特性，不含容感参数，仅适用于静态IR分析，无法反映动态DVD瞬态压降。多电源域需独立计算各自effr，且effr偏高不代表IR必然违例，需结合模块实际工作电流综合判定。
effr是衡量PDN直流供电性能的核心量化指标，真实反映芯片上电后的整体阻抗水平，是后端PI分析与设计优化的重要依据。
8.redhawk中检查的miss via和PR工具中的miss via的区别
RedHawk 的 missing via 检查是供电网格（PDN）电气视角的"网格弱点"检查——定义是"两个重叠的金属 shape 在重叠区域内没有 via" ，本质是判断"缺孔会不会让电流绕长路、把网格变弱" ；PR 工具的 miss via 是几何/制造规则（DRC）+ 连接完整性检查，关注"该有 via 的地方必须有，否则开路/高阻"。两者检查对象重叠但判据、目的、输出完全不同。
9.redhawk是否可以嵌入PR工具做自动分析和修复
Synopsys 生态里 RedHawk 通过 RedHawk Analysis Fusion 直接嵌入 Fusion Compiler/ICC2 实现流程，在布局布线环境内跑 rail 分析并直接做物理修复（如插入 PG via） ；Cadence 生态则走 Innovus 自家 IR-Drop 自动化修复（Voltus 识别 hotspot + 推开 cell / 加 stripe）。RedHawk 强在"分析/诊断 + 修复建议"，全自动物理修复能力有限，大部分修复动作仍需后端工程师在PR 工具里落地。
