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FPGA设计时序分析概念之Timing Arc
在时序工具对设计进行时序分析时,经常会看到一个概念Timing Arch(时序弧)。Timing Arc是一个信号一个单元Cell的输入引脚Pin到该单元输出引脚Output Pin间的路径。对于一个单元Cell,可以存在多个时序弧,通过时序弧的信息,我们可以计算每一段路径的时延从而进行时序分析以及优化。
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