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• 【黑金云课堂】FPGA技术教程Vitis开发：PS端SD读写

  PS 端 SD 卡读写SD 卡原理 1. SD 卡分类 分类方式 类型 尺寸 标准 SD 卡、Micro SD（TF 卡） 速度等级 Class 2/4/6/10，UHS-1 U1/U3 容量 SD (≤2GB)、SDHC (≤32GB)、SDXC (≤2TB) 2. Micro SD 卡引脚说明 3. SD 卡命令与应答格式 Command 命令格式 启动位 主机 命令码 命令参数 CRC 停止

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  5小时前

  FPGA FPGA开发板
• 一文读懂LMS自适应滤波算法：从核心原理到工程实践

  LMS算法是一种基于随机梯度下降的自适应滤波方法，广泛应用于回声消除、主动噪声控制、信道均衡等领域。其核心在于通过不断迭代调整滤波器权重，使输出信号与期望信号之间的均方误差最小。文章详细介绍了LMS算法的基本原理，并通过多个工程实例展示了其在不同应用场景下的高效性能。

  lee

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  5小时前

  滤波算法 自适应滤波器
• FPGA中的IDDR的DDR_CLK_EDGE的属性选择区别

  本文介绍了FPGA中IDDR的DDR_CLK_EDGE属性的选择区别，详细解释了OPPOSITE EDGE、SAME EDGE和SAME EDGE PIPELINED三种模式的特点，并给出实际应用实例，强调了正确选择模式的重要性。

  郝旭帅电子设计团队

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  6小时前

  FPGA

  
• 一次调频和功率预测是难题，CET中电技术如何助力企业并网验收？

  近年来，在我国能源转型的大背景下，由于新能源的大量装机建设。光伏，储能，风电等新能源场站无论是新建还是改造，电网均要求具备一次调频，AGC/AVC，四可等功能。许多产业链同行因不太清楚这些装置的功能及在电网中的应用，从而影响设计选型配置，报价预算等。 一次调频‌是指新能源发电系统在监测到电网频率偏离额定值时(超出死区时)，自动调节其有功功率输出，以维持电网频率稳定的过程。光伏储能风电发电系统通过一

  深圳市中电电力技术股份有限公司

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  06/03 11:44

  控制器
• 深圳中电 PMC-1316 智能通信网关机：一款为工业自动化量身打造的"数据枢纽"

  在电力监控、城市综合管廊、楼宇自动化等场景中，海量现场设备的数据汇聚与协议转换始终是系统集成的核心痛点。PMC-1316 智能通信网关机凭借丰富的协议支持、高可靠硬件设计与灵活的扩展能力，正在成为众多自动化项目中不可或缺的通信骨干节点。 随着工业自动化程度不断提升，发电、配电及用电侧的智能设备数量急剧增长。这些设备往往来自不同厂商，遵循不同的通信规约，如何让它们在同一套监控体系下协同工作，是摆在系

  深圳市中电电力技术股份有限公司

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  06/02 17:49

  智能通信
• FPGA设计时，时序约束的重要性

  本文强调了FPGA设计中时序约束的重要性。时序约束不仅是向工具传达设计意图的关键步骤，还能确保跨时钟域和接口数据的正确采集，并且是解决硬件“玄学”问题的有效方法。通过合理的时序约束，可以避免工具默认配置带来的潜在问题，提高设计的稳定性和可靠性。

  郝旭帅电子设计团队

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  06/02 16:02

  FPGA设计 时序约束
• 【黑金云课堂】FPGA技术教程FPGA基础：FIFO与Uart通信

  一、FIFO 基础概念 定义：FIFO（First In First Out）是一种先进先出的数据缓冲结构，先写入的数据先被读出。 1. 核心特性 读写顺序一致 支持同时读写 提供空（empty）和满（full）状态指示 2. 与 RAM/ 寄存器的区别 FIFO 自动管理指针，无需地址控制，适合顺序访问和速率匹配。 3. 核心价值 跨时钟域（CDC）：消除亚稳态风险 数据缓冲：解耦生产与消费 速

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  06/02 15:52

  FPGA UART
• 国产 FPGA 领军企业启动 IPO 辅导

  高云半导体宣布启动IPO辅导，拟在科创板上市，估值约20亿元。该公司专注于FPGA芯片研发，是国内少数具备千万门级FPGA能力的企业之一。尽管目前仍处于亏损状态，但随着国产替代趋势的加强，市场对其前景看好。

  是说芯语

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  06/01 23:19

  FPGA IPO
• 自动售票机FPGA设计Verilog Quartus

  自动售票机FPGA设计Verilog代码工程源码下载，使用Quartus开发，支持1元、5元、10元投币和1元至4元票价选择。系统具备购票判断、找零、LED指示等功能，适用于FPGA课程设计和状态机控制项目。

  FPGA代码设计学习资料

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  06/01 16:33

  verilog FPGA设计
• FPGA设计时，对外部输入时钟的约束

  本文介绍了在FPGA设计中对外部输入时钟的约束方法。详细解释了如何设置时钟周期为8ns，并使用1.000 ns（峰峰值）约束时钟抖动。此外，还提供了时序分析中不确定性的计算公式，强调了正确描述抖动的重要性。

  郝旭帅电子设计团队

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  06/01 16:28

  FPGA设计
• 基于FPGA的压缩算法加速实现

  本设计实现了一个基于FPGA平台的Gzip压缩算法加速器，通过静态霍夫曼编码和Deflate算法对文件进行高效压缩。项目团队使用C语言实现算法并在Vivado HLS中综合，最终在Pynq-Z2上硬件实现。优化措施包括量化处理、流水线化和内联功能，显著提升了压缩速度。项目成功验证了压缩和解压缩功能的一致性和有效性，压缩比和吞吐率得到了显著改善。

  FPGA技术江湖

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  06/01 11:18

  FPGA 算法

  
• 电子万年历FPGA 设计 Verilog Quartus

  一款基于FPGA的电子万年历系统，使用Verilog语言编写，适用于数字系统设计和Verilog时序逻辑学习。系统支持日期和时间显示切换，具备手动调整功能并附有详细的设计文档和仿真图。

  FPGA代码设计学习资料

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  06/01 08:25

  verilog 万年历电路
• 执法记录仪低功耗计时方案：YSN8563 RTC芯片应用解析

  随着法治化进程加速，执法记录仪已成为公安、城管等执法领域的核心装备。但在一线实战中，执法记录仪普遍存在整机功耗偏高、续航不足、高低温环境计时漂移等计时痛点，容易导致音视频记录时间错乱、证据链失效。 针对以上行业痛点，YXC扬兴科技推出YSN8563低功耗RTC芯片，全面适配执法记录仪全场景需求，是保障执法记录时间精准可靠、实现设备低功耗长续航的关键。 一、YSN8563 核心参数一览 YSN856

  深圳扬兴科技有限公司

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  05/30 09:52

  RTC 时钟芯片

  
• 学FPGA千万别这样学！

  芯火平台提供FPGA入门到进阶的系统培训，涵盖理论、实战和就业辅导，配备专业答疑团队和技术导师，助学员掌握FPGA核心技术，并通过模拟面试提高求职竞争力。

  芯火平台

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  05/29 13:47

  FPGA
• 【FPGA 开发教程】基于 ALINX FPGA 开发板实现 USB3.2 高速通信（Z7-P+FL

  教程目的 基于 ALINX FPGA 开发板 与 FL2010 USB3.2 子卡 实现高速数据通信。 介绍子卡硬件特性、主控芯片功能、FMC 接口连接方式、数据传输模式，为后续基于 USB3.2 的实际应用开发提供基础。 FL2010 USB3.2 子卡 ALINX FL2010 子卡是 USB3.2 FMC 通信模块，与 ALINX FPGA 开发板配合使用，可实现 USB3.2 数据通信。

  ALINX 官方

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  05/29 08:58

  FPGA FMC
• 如何理解时域、s域和z域的联系？

  时域、s域和z域是信号处理与控制工程领域的基础概念，它们分别描述系统状态随时间的变化、模拟频率与衰减特性以及数字频率与稳定性。通过拉普拉斯变换和Z变换，可以将时域的微分方程转化为代数形式，便于分析和设计。双线性变换方法将模拟滤波器的s域传递函数转换为数字滤波器的z域传递函数，保留了低频部分的精度，但在高频处会产生频率扭曲。通过MATLAB代码实例展示了从s域到z域的转换过程，并分析了实际应用中的时域响应和频域响应。

  小灰灰的FPGA

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  05/28 14:34

  时域

  
• 当Vivado开始收过路费

  AMD宣布从Vivado 2026.1版本开始改变规则，引入五档授权模式，其中最低档BASIC版仅支持Windows，而付费版支持双平台，并取消了DFX部分重配置功能。这一举措引发FPGA开发者和社区的广泛关注和讨论，许多人表示不满并寻找替代方案，如Efinix和Lattice。尽管AMD强调此举是为了区分付费能力和培养忠实用户，但许多开发者担忧这会影响未来的生态系统和人才储备。

  土人观芯

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  05/28 13:38

  vivado
• FPGA入门 | Verilog到底是干什么的?

  扫码了解 FPGA 新班详情 芯火平台作为国家级集成电路人才培养基地，拥有高质量的授课师资、完善的课程内容体系、丰富的工程项目实践、95%以上的综合就业率，全面涵盖了理论讲解+岗位专业技能讲授+企业级项目实训+就业服务。

  芯火平台

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  05/28 13:32

  verilog

  
• 西门子PLC到底能不能带EtherCAT伺服？一个稳联网关解决了我三年通信兼容难题

  干了十年工业自动化，我踩过最大的坑，就是“协议兼容”。 2025年，我接手一个汽车配件焊装线的改造项目。甲方原有两条产线，一条是西门子S7-1500带PROFINET驱动器，另一条是后来新上的倍福方案，用的EtherCAT。现在要通过MES把两条线整合，上位用WinCC，PLC主站用一套S7-1500统一控制。但问题来了——新线上那6台EtherCAT伺服（雷赛DM3E系列）根本挂不上PROFIN

  稳联技术

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  05/27 08:52

  PROFINET
• CIC滤波器在FPGA中如何实现？

  CIC滤波器是一种高效且无乘法器的多速率信号处理方法，适用于FPGA实现。本文详细介绍了CIC滤波器的原理、结构、FPGA实现架构及关键设计技巧。通过合理的位宽计算和优化策略，可以在不影响性能的前提下减少资源消耗。

  小灰灰的FPGA

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  1评论

  05/26 13:23

  FPGA 滤波器

  

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